AT89C51单片机英文文献附带翻译Word格式文档下载.docx

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商业应用包括调制解调器，电动机控制系统，打印机，影印机，空调控制系统，磁盘驱动器和医疗设备。

汽车工业把MCS51单片机用于发动机控制系统，悬挂系统和反锁制动系统。

AT89C51尤其很好适用于得益于它的处理速度和增强型片上外围功能集，诸如：

汽车动力控制，车辆动态悬挂，反锁制动和稳定性控制应用。

由于这些决定性应用，市场需要一种可靠的具有低干扰潜伏响应的费用-效能控制器，服务大量时间和事件驱动的在实时应用需要的集成外围的能力，具有在单一程序包中高出平均处理功率的中央处理器。

拥有操作不可预测的设备的经济和法律风险是很高的。

一旦进入市场，尤其任务决定性应用诸如自动驾驶仪或反锁制动系统，错误将是财力上所禁止的。

重新设计的费用可以高达500K美元，如果产品族享有同样内核或外围设计缺陷的话，费用会更高。

另外，部件的替代品领域是极其昂贵的，因为设备要用来把模块典型地焊接成一个总体的价值比各个部件高几倍。

为了缓和这些问题，在最坏的环境和电压条件下对这些单片机进行无论在部件级别还是系统级别上的综合测试是必需的。

IntelChandler平台工程组提供了各种单片机和处理器的系统验证。

这种系统的验证处理可以被分解为三个主要部分。

系统的类型和应用需求决定了能够在设备上执行的测试类型。

1.2AT89C51提供以下标准功能：

4k字节FLASH闪速存储器，128字节内部RAM，32个I/O口线，2个16位定时/计数器，一个5向量两级中断结构，一个全双工串行通信口，片内振荡器及时钟电路。

同时，AT89C51降至0Hz的静态逻辑操作，并支持两种可选的节电工作模式。

空闲方式体制CPU的工作，但允许RAM，定时/计数器，串行通信口及中断系统继续工作。

掉电方式保存RAM中的内容，但振荡器体制工作并禁止其他所有不见工作直到下一个硬件复位。

图1-2-1AT89C51方框图

1.3引脚功能说明

·

Vcc：

电源电压

GND：

地

P0口：

P0口是一组8位漏极开路型双向I/O口，也即地址/数据总线复用。

作为输出口用时，每位能吸收电流的方式驱动8个TTL逻辑门电路，对端口写“1”可作为高阻抗输入端用。

在访问外部数据存储器或程序存储器时，这组口线分时转换地址（低8位）和数据总线复用，在访问期间激活内部上拉电阻。

在Flash编程时，P0口接受指令字节，而在程序校验时，输出指令字节，校验时，要求外接上拉电阻。

P1口：

P1是一个带内部上拉电阻的8位双向I/O口，P1的输出缓冲级可驱动（吸收或输出电流）4个TTL逻辑门电路。

对端口写“1”，通过内部的上拉电阻把端口拉到高电平，此时可作输入口。

作为输入口使用时，因为内部存在上拉电阻，某个引脚被外部信号拉低时会输出一个电流（IIL）。

Flash编程和程序校验期间，P1接受低8位地址。

P2口：

P2是一个带有内部上拉电阻的8位双向I/O口，P2的输出缓冲级可驱动（吸收或输出电流）4个TTL逻辑门电路。

在访问外部程序存储器或16位四肢的外部数据存储器（例如执行MOVX@DPTR指令）时，P2口送出高8位地址数据，在访问8位地址的外部数据存储器（例如执行MOVX@RI指令）时，P2口线上的内容（也即特殊功能寄存器（SFR）区中R2寄存器的内容），在整个访问期间不改变。

Flash编程和程序校验时，P2也接收高位地址和其他控制信号。

P3口：

P3是一个带有内部上拉电阻的8位双向I/O口，P3的输出缓冲级可驱动（吸收或输出电流）4个TTL逻辑门电路。

P3口还接收一些用于Flash闪速存储器编程和程序校验的控制信号。

RST：

复位输入。

当振荡器工作时，RST引脚出现两个机器周期以上高电平将使单片机复位。

ALE/PROG：

当访问外部程序存储器或数据存储器时，ALE（地址锁存允许）输出脉冲用于锁存地址的低8位字节。

即使不访问外部存储器，ALE仍以时钟振荡频率的1/6输出固定的正脉冲信号，因此它可对外输出时钟或用于定时目的。

要注意的是，每当访问外部数据存储器时将跳过一个ALE脉冲。

对Flash存储器编程期间，该引脚还用于输入编程脉冲（PROG）。

如有必要，可通过对特殊功能寄存器（SFR）区中的8EH单元D0位置位，可禁止ALE操作。

该位置位后，只有一条MOVX和MOVC指令ALE才会被激活。

此外，该引脚会被微弱拉高，单片机执行外部程序时，应设置ALE无效。

PSEN：

程序存储允许输出是外部程序存储器的读选通型号，当89C51由外部存储器取指令（或数据）时，每个机器周期两次PSEN有效，即输出两个脉冲。

在此期间，当访问外部数据存储器，这两次有效的PSEN信号不出现。

EA/VPP：

外部访问允许。

欲使CPU仅访问外部程序存储器（地址为

0000H—FFFFH），EA端必须保持低电平（接地）。

需注意的是：

如果加密位LB1被编程，复位时内部会锁存EA端状态。

如EA端为高电平（接Vcc端），CPU则执行内部程序存储器中的指令。

Flash存储器编程时，该引脚加上+12v的编程允许电源Vpp，当然这必须是该器件使用12v编程电压Vpp。

XTAL1：

振荡器反相放大器及内部时钟发生器的输入端。

XTAL2：

振荡器反相放大器的输出端。

89C51中有一个用于构成内部振荡器的高增益反相放大器，引脚XTAL1和XTAL2分别是该放大器的输入端和输出端。

这个放大器与作为反馈元件的片外石英晶体或陶瓷谐振器一起构成自激振荡器，振荡电路参见图5。

外接石英晶体或陶瓷谐振器及电容C1、C2接在放大器的反馈回路中构成并联振荡电路。

对电容C1、C2虽没有十分严格的要求，但电容容量的大小会轻微影响振荡频率的高低、振荡器工作的稳定性、起振的难易程度及温度稳定性，如果使用石英晶体，我们推荐电容使用30Pf±

10Pf，而如使用陶瓷谐振器建议选择40Pf±

10Pf。

用户也可以采用外部时钟。

这种情况下，外部时钟脉冲接到XTAL1端，即内部时钟发生器的输入端XTAL2则悬空。

掉电模式：

在掉电模式下，振荡器停止工作，进入掉电模式的指令是最后一条被执行的指令，片内RAM和特殊功能寄存器的内容在终止掉电模式前被冻结。

推出掉电模式的唯一方法是硬件复位，复位后将重新定义全部特殊功能寄存器但不改变RAM中的内容，在Vcc恢复到正常工作电平前，复位应无效，且必须保持一定时间以使振荡器重启动并稳定工作。

89C51的程序存储器阵列是采用字节写入方式编程的，每次写入一个字符，要对整个芯片的EPROM程序存储器写入一个非空字节，必须使用片擦除的方法将整个存储器的内容清楚。

2编程方法

编程前，设置好地址、数据及控制信号，编程单元的地址加在P1口和P2口的P2.0—P2.3（11位地址范围为0000H——0FFFH），数据从P0口输入，引脚P2.6、P2.7和P3.6、P3.7的电平设置见表6，PSEB为低电平，RST保持高电平，EA/Vpp引脚是编程电源的输入端，按要求加上编程电压，ALE/PROG引脚输入编程脉冲（负脉冲）。

编程时，可采用4—20MHz的时钟振荡器，89C51编程方法如下：

在地址线上加上要编程单元的地址信号在数据线上加上要写入的数据字节。

激活相应的控制信号。

在高电压编程方式时，将EA/Vpp端加上+12v编程电压。

每对Flash存储阵列写入一个字节或每写入一个程序加密位，加上一个ALE/PROG编程脉冲。

改变编程单元的地址和写入的数据，重复1—5步骤，知道全部文件编程结束。

每个字节写入周期是自身定时的，通常约为1.5ms。

数据查询89C51单片机用数据查询方式来检测一个写周期是否结束，在一个写周期中，如需要读取最后写入的那个字节，则读出的数据的最高位（P0.7）是原来写入字节的最高位的反码。

写周期开始后，可在任意时刻进行数据查询。

2.1Ready/Busy:

字节编程的进度可通过Ready/Busy输出信号检测，编程期间，ALE变为高电平“H”后P3.4（Ready/Busy）端被拉低，表示正在编程状态（忙状态）。

编程完成后，P3.4变为高电平表示准备就绪状态。

程序校验：

如果加密位LB、LB2没有进行编程，则代码数据可通过地址和数据线读回原编写的数据，采用下图的电路，程序存储器的地址由P1口和P2口的P2.0—P2.3输入，数据由P0口读出，P206、P2.7和P3.6、P3.7的控制信号见表6，PSEN保持低电平，ALE、EA和RST保持高电平。

校验时，P0口必须接上10k左右的上拉电阻。

图2-1-1编程电路图2-2-2校验电路

2.2芯片擦除:

利用控制信号的正确组合（表6）并保持ALE/PROG引脚10ms的低电平脉冲宽度即可将EPROM阵列（4k字节）和三个加密位整片擦除,代码阵列在片擦除操作中将任何非空单元写入”1”,这步骤需在编程之前进行。

2.3读片内签名字节:

89C51单片机内有3个签名字节,地址为030H、031H和032H。

于声明该器件的厂商、号和编程电压。

读签名字节的过程和单元030H、031H和032H的正常校验相仿，只需要将P3.6和P3.7保持低电平，返回值意义如下：

（030H）=1EH声明产品由ATMEL公司制造。

（031H）=51H声明为89C51单片机。

（032H）=FFH声明为12V编程电压。

（032H）=05H声明为5编程电压。

2.4编程接口：

采用控制信号的正确组合可对Flash闪速存储阵列中的每一代码字节进行写入和存储器的整片擦除，写操作周期是自身定时的，初始化后它将自动定时到操作完成。

微机接口实现两种信息形式的交换。

在计算机之外，由电子系统所处理的信息以一种物理信号形式存在，但在程序中，它是用数字表示的。

任一接口的功能都可分为以某种形式进行数据库变换的一些操作，所以外部和内部形式的转换是由许多步骤完成的。

模拟-数字转换器（ADC）用来将连续变化信号变成相应的数字量，这数字量可是可能性的二进制数值中的一固定值。

如果传感器输出不是连续变化的，就不需模拟-数字转换。

这种情况下，信号调理单元必须将输入信号变换成为另一信号，也可直接与接口的下一部分，即微计算机本身的输入输出单元相连接。

输出接口采用相似的形式，明显的差别在于信息流的方向相反；

是从程序到外部世界。

这种情况下，程序可称为输出程序，它监督接口的操作并完成数字-模拟转换器（DAC）所需数字的标定。

该子程序依次送出信息给输出器件，产生相应的电信号，由DAC转换成模拟形式。

最后，信号经调理（通常是放大）以形成适应于执行器操作的形式。

在微机电路中使用的信号几乎总是太小而不能被直接地连到“外部世界”，因而必须用某种形式将其转换成更适宜的形式。

接口电路部分的设计是使用微机的工程师所面临最重要的任务之一。

我们已经了解到微机中，信号以离散的位形式表示。

当微机要与只有打开或关闭操作的设备相连时，这种数字形式是最有用的，这里每一位都可表示一开关或执行器的状态。

为了解决实际问题，一个单片机不仅包括CPU，程序和数据存储器，另外，它必须含有通过CPU访问外部信息的硬件。

一旦CPU收集到数据信息和流程，它必须能够改变外部领域的一部分，这些硬件设备称作外围设备，它们是CPU通往外部的窗口。

单片机可利用外围设备中最基本的用于一般用途的I/O接口，每个I/O接口既可作为输入端又可作为输出端，每个I/O接口的功能取决与程序初始化阶段对数据方位寄存器相应位进行置一和清零操作，通过CPU指令对数据寄存器相应位进行置一和清零来置一和清零输出端口，同样输入端口逻辑位也可以通过CPU指令访问。

一些类型的串行口单元允许CPU与外部设备进行串口通信，用串口位代替平行位进行通信需要少许的I/O口，这样使通信费用降低但速度也相对慢些。

串口传送可以同步也可以异步。

TheGeneralSituationofAT89C51

Chapter1TheapplicationofAT89C51

Microcontrollersareusedinamultitudeofcommercialapplicationssuchasmodems,motor-controlsystems,airconditionercontrolsystems,automotiveengineandamongothers.Thehighprocessingspeedandenhancedperipheralsetofthesemicrocontrollersmakethemsuitableforsuchhigh-speedevent-basedapplications.However,thesecriticalapplicationdomainsalsorequirethatthesemicrocontrollersarehighlyreliable.Thehighreliabilityandlowmarketriskscanbeensuredbyarobusttestingprocessandapropertoolsenvironmentforthevalidationofthesemicrocontrollersbothatthecomponentandatthesystemlevel.IntelPlaformEngineeringdepartmentdevelopedanobject-orientedmulti-threadedtestenvironmentforthevalidationofitsAT89C51automotivemicrocontrollers.ThegoalsofthisenvironmentwasnotonlytoprovidearobusttestingenvironmentfortheAT89C51automotivemicrocontrollers,buttodevelopanenvironmentwhichcanbeeasilyextendedandreusedforthevalidationofseveralotherfuturemicrocontrollers.TheenvironmentwasdevelopedinconjunctionwithMicrosoftFoundationClasses（AT89C51）.Thepaperdescribesthedesignandmechanismofthistestenvironment,itsinteractionswithvarioushardware/softwareenvironmentalcomponents,andhowtouseAT89C51.

1.1Introduction

The8-bitAT89C51CHMOSmicrocontrollersaredesignedtohandlehigh-speedcalculationsandfastinput/outputoperations.MCS51microcontrollersaretypicallyusedforhigh-speedeventcontrolsystems.Commercialapplicationsincludemodems,motor-controlsystems,printers,photocopiers,airconditionercontrolsystems,diskdrives,andmedicalinstruments.TheautomotiveindustryuseMCS51microcontrollersinengine-controlsystems,airbags,suspensionsystems,andantilockbrakingsystems（ABS）.TheAT89C51isespeciallywellsuitedtoapplicationsthatbenefitfromitsprocessingspeedandenhancedon-chipperipheralfunctionsset,suchasautomotivepower-traincontrol,vehicledynamicsuspension,antilockbraking,andstabilitycontrolapplications.Becauseofthesecriticalapplications,themarketrequiresareliablecost-effectivecontrollerwithalowinterruptlatencyresponse,abilitytoservicethehighnumberoftimeandeventdrivenintegratedperipheralsneededinrealtimeapplications,andaCPUwithaboveaverageprocessingpowerinasinglepackage.Thefinancialandlegalriskofhavingdevicesthatoperateunpredictablyisveryhigh.Onceinthemarket,particularlyinmissioncriticalapplicationssuchasanautopilotoranti-lockbrakingsystem,mistakesarefinanciallyprohibitive.Redesigncostscanrunashighasa$500K,muchmoreifthefixmeans2backannotatingitacrossaproductfamilythatsharethesamecoreand/orperipheraldesignflaw.Inaddition,fieldreplacementsofcomponentsisextremelyexpensive,asthedevicesaretypicallysealedinmoduleswithatotalvalueseveraltimesthatofthecomponent.Tomitigatetheseproblems,itisessentialthatcomprehensivetestingofthecontrollersbecarriedoutatboththecomponentlevelandsystemlevelunderworstcaseenvironmentalandvoltageconditions.Thiscompleteandthoroughvalidationnecessitatesnotonlyawell-definedprocessbutalsoaproperenvironmentandtoolstofacilitateandexecutethemissionsuccessfully.IntelChandlerPlatformEngineeringgroupprovidespostsiliconsystemvalidation（SV）ofvariousmicro-controllersandprocessors.Thesystemvalidationprocesscanbebrokenintothreemajorparts.Thetypeofthedeviceanditsapplicationrequirementsdeterminewhichtypesoftestingareperformedonthedevice.

1.2TheAT89C51providesthefollowingstandardfeatures:

4KbytesofFlash,128bytesofRAM,32I/Olines,two16-bittimer/counters,afivevectortwo-levelinterruptarchitecture,afulldupleser-ialport,on-chiposcillatorandclockcircuitry.Inaddition,theAT89C51isdesignedwithstaticlogicforoperationdowntozerofrequencyandsupportstwosoftwareselectablepowersavingmodes.TheIdleModestopstheCPUwhileallowingtheRAM,timer/counters,serialportandinterruptsys-temtocontinuefunctioning.ThePower-downModesaves