一位全减器的设计Word格式文档下载.docx

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院系：

专业：

电子信息工程

组员：

设计流程:

一、一位半减器的设计

一位半减器程序如下;

其中x,y是输入，diff是输出差，s_out是借位输出,sub_in为借位输入。

libraryieee;

useieee.std_logic_1164.all;

entityh_suberis

port（x,y:

instd_logic;

diff,s_out:

outstd_logic）;

endh_suber;

architecturehdlarchofh_suberis

begin

process（x,y）

begin

diff<

=xxory;

s_out<

=（notx）andy;

endprocess;

endhdlarch;

半减器逻辑表达式:

半减器真值表：

输入

输出

x

y

diff

s_sout

1

半减器波形图如下：

半减器封装图：

二、一位全减器的设计

一位全减器设计结构图：

sub_in为借位输入,clk是输入延迟信号用来消除仿真图中出现的毛刺现象

一位全减器逻辑表达式：

一位全减器真值表：

sub_in

differ

sub_out

一位全减器波形图：

一位全减器封装图：