现场可编程逻辑门阵列FPGA真题精选Word文档格式.docx

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映射

4系统仿真分为()、()和()。

行为仿真;

功能仿真;

时序仿真

5()仿真是布局布线后进行的后仿真,仿真时考虑了布线延时,和芯片实际的工作情况更加接近。

时序

6现代电子系统设计领域中的EDA采用()的设计方法。

自顶向下

7Verilog HDL常用两大数据类型:

()、()。

线网类型;

寄存器类型

8连续赋值常用于数据流行为建模,常以()为关键词。

assign

9未来的集成电路技术的发展趋势,把整上系统集成在一个芯片上去,这种芯片被称为()。

片上系统SOC

10FPGA的核心部分是(),由内部逻辑块矩阵和周围I/O接口模块组成。

逻辑单元阵列LCA

11FPGA的配置模式有从动串行模式、从动并行模式、主动串行模式、主动并行模式、以及()模式。

JTAG

12在verilog HDL的always块本身是()语句。

并行

13Verilog HDL很好地支持了“自顶向下”的设计理念,即,复杂任务分解成的小模块完成后,可以通过()的方式,将系统组装起来。

调用(也称例化)

14state,State,这两个标识符是()的。

不同

15在Verilog HDL的逻辑运算中,设a=2,b=0,则a&

&

b结果为(), a||b结果为()。

0;

1

16LUT

全名look up table,为查找表。

17GAL

全名Generic Array Logic,为可编程通用阵列逻辑。

[单项选择题]

18、任Verilog HDL的端口声明语句中,用()关键字声明端口为双向端口。

A.inout

B.INOUT

C.BUFFER

D.buffer

A

19、在Verilog HDL的逻辑运算中,设A=8’b11010001,B=8’b00011001,则表达式“A&

B”的结果为()。

A.8’b00010001

B.8’b11011001

C.8’b11001000

D.8’b00110111

20、CPLD的可编程是主要基于什么结构()。

A.查找表(LUT)

B.ROM可编程

C.PAL可编程

D.与或阵列可编程

D

21、CPLD可编程逻辑基于的可编程结构基于()。

A.LUT结构

B.乘积项结构

C.PLD

D.都不对

B

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22、任Verilog HDL的标识符使用字母的规则是()。

A.大小写相同

B.大小写不同

C.只允许大写

D.只允许小写

23、在Verilog HDL模块中,函数调用时返回一个用于()的值。

A.表达式

B.输出

C.输入

D.程序包

24简述EDA技术的发展历程?

(1)二十世纪70年代,产生了第一代EDA工具。

(2)到了80年代,为了适应电子产品在规模和制作上的需要,应运出现了以计算机仿真和自动布线为核心技术的第二代EDA技术。

(3)90年代后,随着科学技术的发展,出现了以高级语言描述、系统级仿真和综合技术为特征的第三代EDA技术。

25自顶向下的设计方法有什么重要意义?

(1)基于PLD硬件和EDA工具支撑;

(2)采用逐级仿真技术,以便及早发现问题修改设计方案;

(3)基于网上设计技术使全球设计者设计成果共享,设计成果的再利用得到保证;

(4)复杂系统的设计规模和效率大幅度提高;

(5)在选择器件的类型、规模、硬件结构等方面具有更大的自由度。

26简述原理图设计法设计流程。

具体设计流程包括设计输入、功能仿真、综合、综合后仿真、约束设置、实现、布局布线后仿真、生成配置文件与配置FPGA。

27什么是基于平台的设计?

现有平台分为哪几个类型?

基于平台的设计方法是近几年提出的SOC软硬件协同设计新方法,是基于块的设计BBD方法的延伸,它扩展了设计重用的理念,强调系统级复用,包含了时序驱动的设计和BBD的各种技术,支持软硬件协同设计,提供系统级的算法和结构分析。

现有的设计平台分为四类:

完整的应用平台;

以处理器为中心的平台;

以片内通信构造为中心的平台;

完整的可编程平台。

28SOPC技术含义是什么?

SOPC技术和SOC技术的区别是什么?

SOPC技术是以可编程逻辑器件PLD取代ASIC,更加灵活、高效的技术SOC解决方案。

SOPC与SOC的区别就是FPGA与ASIC的区别。

SOPC是SOC发展的新阶段,代表了当今电子设计的发展方向。

其基本特征是设计人员采用自顶向下的设计方法,对整个系统进行方案设计和功能划分,最后系统的核心电路在可编程器件上实现。

29综合完成的主要工作是什么?

实现(Implement)完成的主要工作是什么?

综合的主要工作将硬件描述语言转化成硬件电路。

实现(Implement)是指将综合输出的逻辑网表翻译成所选器件的底层模块与硬件原语,将设计映射到器件结构上,进行布局布线,达到在选定器件上实现设计的目的。

30简述过程赋值和连续赋值的区别。

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