数字逻辑模拟试题.docx
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数字逻辑模拟试题
数字逻辑模拟试题
一．单项选择题1．表示任意两位无符号十进制数至少需要（）二进
制数。
A．6B．7C．8D．9
2．余3码10001000对应的2421码为（）。
A．01010101B.10000101C.10111011D.
11101011
3．下列四个数中与十进制数（72）10相等的是（）
A．（01101000）2B.（01001000）2
C.（01110010）2D.（01001010）2
4．某集成电路芯片，查手册知其最大输出低电平
UoLmax=0.5V，最大输入低电平UlLmax=0.8V，最小输出咼电平UoHmin=2.7V，最小输入高电平UlHmin=2.0V，则其高电平噪声容限Unh=（）
5•标准或-与式是由（）构成的逻辑表达式。
A•与项相或B.最小项相或C.最大项相与
D.或项相与
6.根据反演规则，
FA
C
C
DE
E的反函数
为（）。
A.F[ACC（D
E）]E
B.
F
AC
c（D
E）E
C.F（ACCD
E）E
D.
F
AC
C（D
e）E
7、对于TTL或非门多余输入端的处理，不可以（）（
A、接电源B、通过0.5kQ电阻接地
C、接地D、与有用输入端并联
8•下列四种类型的逻辑门中，可以用（）实现三种
基本逻辑运算。
A.与门B.或门C.非门D.与非门
9.将D触发器改造成T触发器，图1所示电路中的虚线框内应是（）。
A.或非门B.与非门C.异或门D.同或门
10.以下电路中可以实现线与功能的有（）。
A.与非门B.三态输出门C.传输门D.漏极开路门
11•要使JK触发器在时钟作用下的次态与现态相反，
JK端取值应为（）。
A.JK=00B.JK=01C.JK=10D.JK=11
12•设计一个四位二进制码的奇偶校验器，需要（）
个异或门。
A.2B.3C.4D.5
13.相邻两组编码只有一位不同的编码是（）
A.2421BCD码B.8421BCD码C.余3码D.循环码
14•下列电路中，不属于时序逻辑电路的是（）
A.计数器B.全加器C.寄存器D.RAM
15.—个4位移位寄存器，现态为0111,经右移1位后其次
态为（）
A.0011或1011B.1101或1110
C.1011或1110D.0011或1111
16.为了将正弦信号转换成与之频率相同的脉冲信号，可采用（）
A.多谐振荡器B.移位寄存器
C.单稳态触发器D.施密特触发器
17•—个6位地址码、8位输出的ROM其存储矩阵的容量
为（）bit.
A.64X8B.48C.256D.8
18.某8位DAC当输入全为1时，输出电压为5.10V，当
输入D=（10000000）2时，输出电压为（）
A.5.10VB.2.56VC.1.28VD.都不是
19.PROM是一种编程逻辑器件。
（）
A.与阵列可编程、或阵列固定的
B.与阵列固定、或阵列可编程的
C.与、或阵列固定的D.与、或阵列都可编程的
20.ROM不能用于。
A.函数运算表B.存入程序
C.存入采集的动态数据D.字符发生器二•多项选择题
1逻辑函数F=A㊉B和G=AOB满足关系（）。
A.FGB.FGc.FGD.FG1
2•函数F（A,B,C）m（1,2,3,6）,G（A,B,C）m（0,2,3,4,5,7）,
则F和G相与”的结果是（）。
A.m2m3B.1C.ABD.AB
3•设两输入或非门的输入为x和y，输出为z,当z为低
电平时，有（）。
A.x和y同为高电平；B.x为高电平，y为低电平；
C.x为低电平，y为高电平；D.x和y同为低电平.
4.组合逻辑电路的输出与输入的关系可用（）描述。
A.真值表B.流程表C.逻辑表达式D.状态图
5.TTL电路在正逻辑系统中，以下输入中（）相当于接1。
A.悬空B.通过3kQ电阻接电源
C.通过3kQ电阻接地D.通过510Q电阻接地
三．填空题
1．数字逻辑电路可分为组合和两大类。
2．用与、或、非等运算表示函数中各个变量之间逻辑关系的代数式叫。
3.四变量逻辑函数的标准与或式为F（a,b,c,d）=刀m（0,2,3,4,6,8,9,11,13），其标准或与式为，
它的反函数的标准与或式为。
4.三态逻辑门输出有三种状态：
0态、1态和。
5.在组合逻辑电路中，当输入信号改变状态时，输出
端可能出现的虚假过渡干扰脉冲的现象称为
6.根据需要选择一路信号送到公共数据线上的电路叫
。
7.16个触发器构成计数器，该计数器可能的最大计数
模值是。
8.触发器按功能分可分为RS、D、JK、T和。
9•某计数器的输出波形如图1所示，该计数器是
制计数器。
图1
10•Moore型时序逻辑电路的输出仅仅取决于而不受电路当时的输入信号影响或没有输入变量。
11•对于一个频率有限的模拟信号，设其最高频率分量
的频率为fmax，在取样后为了无失真地恢复原始输入
信号频谱，取样时必须满足取样频率：
fs>。
12.为了构成8KX16bit的RAM，需要片1KX
8bit的RAM，地址线的高位作为地址译码的输
入，地址译码使用的是―线一―线译码器。
13.在A/D转换中，最小量化单位为△，如果使用四舍
五入法，最大量化误差为_，如果使用只舍不入法，
最大量化误差为—。
14.10位A/D转换器中，已知输出为258H时，对应的输入电压为1.2V，则当输入的电压为1.8V时，输出的数字量是
Ho
15.74LS138是3线-8线译码器，译码输出为低电平有效，
若输入A2A1A0=100时，输出丫7丫6丫5丫4丫3丫2丫1丫0=o
16.8线7线优先编码器74LS148的优先权顺序是丨7，16,?
?
|1，Io，输入低电平有效，输出“丫1Y0为二进制反码输出。
当|7|6|5|4|3|2|1|0为11010101时，输出丫2丫1丫0=o
四、分析题
1•用图形法将下列逻辑函数化成最简与或”式
F（A,B,C,D）=刀m（Q2,4,5,6,7,12）+刀d（810）2•分析图中所示电路的逻辑功能。
列出真值表，写出电路输出函数S的逻辑表达式。
3、分析图中所示的组合逻辑电路，要求:
（1）写出输出丫1、丫2的表达式。
（2）列出真值表
（3）说明电路逻辑功能
A
C
4•根据图中所示4选1数据选择器实现的组合电路，写出输出E表达式并化成最简与或”表达式。
cdcd
图4
5、时序电路如图所示，写出各触发器的驱动方程、该电路的状态方程，并画出状态转换图，说明电路功能（设各触发器的初态均为0）。
6、电路如图所示，已知CP端输入脉冲的频率为10kHz,试分析当输入控制信号A,B,C,D,E,F,G,H,I分别为低电平时，丫端输出的脉冲频率各为多少？
并说明电路的逻辑功能。
B
I
五、设计题
1•在举重比赛中，有甲、乙、丙三位裁判，其中甲为主裁判，当两位或两位以上裁判（其中必须包括主裁判在内）认为运动员上举合格，才可发出合格信号，用最少的与非门设计满足上述要求的组合逻辑电路。
2、试用PLA设计一个满足以下要求的译码电路。
该电路输入信号DCBA为4位二进制码。
输出信号丫1、丫2、丫3在下列几种情况下有确定的状态：
1当DCBA所对应的十进制数为1~3时，丫1=1，
丫2=丫3=0；
2当DCBA所对应的十进制数为6〜8时，丫2=1，
丫1=丫3=0；
3当DCBA所对应的十进制数为11~13时，丫3=1，
丫1=丫2=0。
A——
］丫1
B——
译
—丫2
C——
器
丫3
D——
3•用同步四位二进制计数器74161构成初始状态为0100的七进制计数器。
画出状态转换图和连线图。
4•用同步四位二进制计数器74160构成48进制的计数器。
画出状态转换图和连线图。
5、用八选一数据选择器74HC151设计一个函数发生器电路，S1、S2为控制端，A、B为逻辑变量输入端，丫为函数发生器输出端，要实现的功能如图所示。
S\
\J
Y
0
0
AB
0
1
4+B
i
0
A®B
i
1
A
6、图（a）是一个序列信号产生电路的框图，其输出L与时钟脉冲CP的波形如图（b）所示。
试用边沿D触发器和中规模组合逻辑器件设计该时序电路。
l~HJ-TT1LlTT
（C）各电
L2和L3
（b）
六、作图题
1图中（d）所示A、B、C信号为图（a）、（b）路的输入波形。
分析电路，试对应画出L1、的输出波形。
'VCC
A
B
A
B
（0
T
B
（d）
2、触发器电路及输入信号的波形如图所示，试分别
画出D触发器的Q和Q1的波形。
3•由集成定时器555的电路如图7所示，请回答下列问题。
（1）构成电路的名称;
（2）已知输入信号波形Ui,画出电路中uo的波形（标明uo波形的脉冲宽度）；
6
7
THOUT
TR555
GNDCO
5
DISC
+6V
~0.0IgF
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