数字数电子技术实验报告docx.docx
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数字数电子技术实验报告docx
专业：
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学号：
姓名：
指导教师：
电气学院
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实验一集成门电路逻辑功能测试
一、实验目的
1.验证常用集成门电路的逻辑功能;
2.熟悉各种门电路的逻辑符号;
3.熟悉TTL集成电路的特点，使用规则和使用方法。
二、实验设备及器件
1.
数字电路实验箱
2.
万用表
3.
74LS00四2输入与非门
1片
74LS86四2输入异或门
1片
74LS11三3输入与门
1片
74LS32四2输入或门
1片
74LS04反相器
1片
三、实验原理
集成逻辑门电路是最简单，最基本的数字集成元件，目前已有种类齐全集
成门电路。
TTL集成电路由于工作速度高，输出幅度大，种类多，不宜损坏等特
点而得到广泛使用，特别对学生进行实验论证，选用TTL电路较合适，因此这里
使用了74LS系列的TTL成路，它的电源电压为5V+10%,逻辑高电平“1”时＞2.4V，
低电平“0”时＜0.4V。
实验使用的集成电路都采用的是双列直插式封装形式，
其管脚的识别方法为：
将集成块的正面（印有集成电路型号标记面）对着使用者，集成电路上的标识凹口左，左下角第一脚为1脚，按逆时针方向顺序排布其管脚。
四、实验内容
㈠根据接线图连接，测试各门电路逻辑功能
1.利用Multisim画出以74LS11为测试器件的与门逻辑功能仿真图如下
-2
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按表1—1要求用开关改变输入端A,B,C的状态，借助指示灯观测各相应输出端F的状态，当电平指示灯亮时记为1，灭时记为0，把测试结果填入表1—1中。
表1-174LS11逻辑功能表
输入状态
输出状态
A
B
C
Y
0
0
0
0
0
0
1
0
0
1
0
0
0
1
1
0
1
0
0
0
1
0
1
0
1
1
0
0
1
1
1
1
悬空
1
1
1
悬空
0
0
0
2.利用Multisim画出以74LS32为测试器件的或门逻辑功能仿真图如下
-3
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按表1—2要求用开关改变输入端A,B的状态，借助指示灯观测各相应输出
端F的状态，把测试结果填入表1—2中。
表1—274LS32逻辑功能表
输入状态
输出状态
A
B
Y
0
0
0
0
1
1
1
0
1
1
1
1
0
悬空
1
1
悬空
1
悬空
0
1
悬空
1
1
悬空
悬空
1
3.利用Multisim画出以74LS04为测试器件的非门逻辑功能仿真图如下
-4
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按表1—3要求用开关改变电平开关的状态，借助指示灯观测各相应输出端F的状态，把测试结果填入表1—3中。
表1—374LS04逻辑功能表
输入输出状态（0|1）
01
00
悬空0
㈡根据管脚功能图连接，测试各门电路逻辑功能
1.74LS00四二输入与非门管脚功能如下图所示，用其中一个门测试其逻辑功能。
-5
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利用Multisim画出以74LS00为测试器件的非门逻辑功能仿真图如下
按表1—4要求用开关改变输入端的状态，借助指示灯观测各相应输出端的状态，把测试结果填入表1—4中。
表1—474LS00逻辑功能表
输入状态
输出状态
UA
UB
Y
0
0
1
0
1
1
1
0
1
1
1
0
0
悬空
1
1
悬空
0
悬空
0
1
悬空
1
0
悬空
悬空
0
2.74LS86四二输入异或门管脚功能如下图所示，
用其中一个门测试其逻辑功能。
-6
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利用Multisim画出以74LS86为测试器件的非门逻辑功能仿真图如下
按表1—5要求用开关改变输入端的状态，借助指示灯观测各相应输出端的状态，把测试结果填入表1—5中。
表1—574LS86逻辑功能表
ABC
000
011
101
110
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五、实验总结
实验前应检查集成块是否插对；
实验时要将电源电压接入+5V。
在这次实验中，刚开始由于没有将电源电压接入面板上对应的位子，只是按照管脚图直接连接了电源线和地线，造成实验箱上的灯不亮。
同时发现由于有个别的发光二极管与导线会接触不良，使发光二极管闪烁着，间歇性的亮，这时应换一个发光二极管再进行实验。
-8
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实验二用小规模集成电路设计组合逻辑电路
一、实验目的
1.掌握组合逻辑电路的特点；
2.掌握小规模集成电路设计组合电路的方法；
3.掌握电路故障检测方法。
二、实验设备及器件
1.数字电路实验箱；
2.74LS00/74LS11/74LS20/74LS86等芯片。
三、实验原理
1.数字电路的两大电路是组合逻辑电路和时序逻辑电路，其中组合逻辑电路的特点是任何时刻的输出仅仅取决于同一时刻输入信号的取值组合。
2.用小规模集成电路设计组合逻辑电路的步骤为：
⑴分析设计要求，设置输入和输出变量；
⑵列出真值表；
⑶写出逻辑表达式，并化简；
⑷画出逻辑电路图。
四、实验内容
1.有一个火灾报警系统，设有烟感、温感和紫外线光感三种类型的火灾探测器。
为了防止误报警，只有当其中有两种或两种以上类型的探测器发出火灾检测信号时，报警系统才产生报警控制信号。
试设计一个产生警报控制信号的电路并在实验箱上验证。
设烟感、温感和紫外线光感分别为A、B、C三中输入，报警时输出高电平
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“1”，其报警信号为Y。
真值表如下：
输入信号
输出信号
A
B
C
Y
0
0
0
0
0
0
1
0
0
1
0
0
0
1
1
1
1
0
0
0
1
0
1
1
1
1
0
1
1
1
1
1
因为：
Y=BC+AC+AB或Y=（（AB）’（AC）’（BC）’）’=（AB）’（AC）’+BC利用一个与非门（74LS00）和一个非门（74LS02）或利用一个与门（74LS11）与一个或门（74LS02）组成逻辑电路，其电路仿真图如下：
3.设计一个一位半加器，该逻辑电路能对两个一位二进制数进行相加，并产生“和”及“进位”，在实验箱上进行验证。
-10
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依题意列出真值表如下：
输入
输出
A
B
S
CO
0
0
0
0
0
1
1
0
1
0
1
0
1
1
0
1
因为：
S=A’B+B’A=A○+B
CO=AB
所以利用一个异或门一个与门组成逻辑电路，其电路仿真图如下：
五、实验总结
实验注意事项
1.注意集成电路多余端的处理;
2.两个集成芯片的连接注意电平是否匹配;
3.小规模集成电路设计组合电路，尽量使用较少的门电路，尽量使用与非门，提高电路的负载能力和抗干扰能力。
-11
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实验三译码器及其应用
一、实验目的：
1、掌握译码器的测试方法，熟悉数码管的使用；
2、了解中规模集成译码器的原理，管脚分布，掌握其逻辑功能，以及译码
显示器电路的构成原理；
3、掌握用译码器构成组合电路的方法和BCD-七段译码/驱动器的使用方
法。
4、学习译码器的扩展。
二、实验设备及其器件
1、SAC-DM32数字电路实验箱
1个
2、74LS138
3-8线译码器
2片
3、74LS20双4输入与非门
1片
4、74LS47（译码显示器）
1片
5、共阳极七段数码管
1个
三、实验原理
1、中规模集成译码器74LS138
74LS138是集成3线-8线译码器，在数字系统中应用比较广泛。
图3-1是其引脚排列。
其中A2、A1、A0为地址输入端，Y0`～Y7为译码输出端,S1、S2、S3为
使能端。
表3-1为74LS138truthtable。
74LS138工作原理为：
当S1=1，S2+S3=0时，电路完成译码功能，输出低电
平有效。
其中：
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表3-174LS138真值表
输入输出
S
A
A
A
Y
Y
Y
Y
Y
Y
Y
Y
2
1
0
0
1
2
3
4
5
6
7
0
×××
1
1
1
1
1
1
1
1
1
0
0
0
0
1
1
1
1
1
1
1
1
0
0
1
1
0
1
1
1
1
1
1
1
0
1
0
1
1
0
1
1
1
1
1
1
0
1
1
1
1
1
0
1
1
1
1
1
1
0
0
1
1
1
1
0
1
1
1
1
1
0
1
1
1
1
1
1
0
1
1
1
1
1
0
1
1
1
1
1
1
0
1
1
1
1
1
1
1
1
1
1
1
1
0
图3-174LS138引脚
-13
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图3-274LS138内部电路图
2、译码器的应用（见实验指导书P11-P12）
3、显示译码管
（1）七段发光二极管（LED）数码管
LED数码管是目前最常用的数字显示器。
以下是数字显示器的介绍（详细见实验指导书P12-P13）：
-14
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四、实验内容：
1、译码器74Ls138逻辑功能测试
（一）控制端功能测试
测试电路如图3-6所示。
按表3-2所示条件输入开关状态。
观察并记录译码
器输出状态。
LED指示灯亮为1，灯不亮为0。
表3-2
74LS138控制端功能测试
S1
错误!
未找到引用
2
1
0
0
1
2
3
4
5
6
7
源。
2
错误!
未找到引用
源。
3
0
xx
Xxx
1
1
1
1
1
1
1
1
1
1
0
Xxx
1
1
1
1
1
1
1
1
1
0
1
Xxx
1
1
1
1
1
1
1
1
1
1
1
Xxx
1
1
1
1
1
1
1
1
图3-674LS138控制端功能测试电路
（二）逻辑功能测试
将译码器使能端S1、错误!
未找到引用源。
2、错误!
未找到引用源。
3及地址段2、1、0分别接至逻
辑电平开关输出孔，八个输出端7···0依次连接在了逻辑电平显示器的八个
-15
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输入孔上，拨动逻辑电平开关，按表3-3逐项测试74LS138的逻辑功能。
表3-374LS138的逻辑功能测试
输
入
输
出
S1错误!
未
2
1
0
0
1
2
3
4
5
6
7
找到引
用源。
2+错
误!
未找
到引用
源。
3
1
0
0
0
0
0
1
1
1
1
1
1
1
1
0
0
0
1
1
0
1
1
1
1
1
1
1
0
0
1
0
1
1
0
1
1
1
1
1
1
0
0
1
1
1
1
1
0
1
1
1
1
1
0
1
0
0
1
1
1
1
0
1
1
1
1
0
1
0
1
1
1
1
1
1
0
1
1
1
0
1
1
0
1
1
1
1
1
1
0
1
1
0
1
1
1
1
1
1
1
1
1
1
0
0
X
X
X
X
1
1
1
1
1
1
1
1
X
1
X
X
X
1
1
1
1
1
1
1
1
2、用74LS138实现逻辑功能
Y=AB+BC+AC
如果设A2=A，A1=B、A0=C，则函数Y的逻辑图如3-7所示。
-16
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图3-7用74LS138组成函数Y
用74LS138和74LS20各一块在实验箱上连接图3-7线路，并将测试结果记录表3-4中。
其实验电路如下：
表3-4
函数功能测试
A
B
C
Y
0
0
0
0
0
0
1
0
0
1
0
0
0
1
1
1
1
0
0
0
1
0
1
1
1
1
0
1
1
1
1
1
3、试用一片74LS138和一片74LS20实现全加器功能，自拟电路图如下：
-17
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其真值表如下所示：
输
入
输
出
CI
A
B
S
C0
0
0
0
1
0
0
0
1
1
0
0
1
0
0
1
0
1
1
0
1
1
0
0
1
0
1
0
1
0
1
1
1
0
0
1
1
1
1
1
1
五、实验总结
1.注意集成电路输入控制端和输出控制端的信号；
2.74LS138集成块搭接中注意输出信号的输出；
3.注意74LS47控制端的信号；
4.显示器管脚与译码器的对应关系。
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实验四数据选择器及其应用
一、实验目的
1、学习数据选择器逻辑功能测试方法；
2、了解中规模集成数据选择器的功能、管脚排列，掌握其逻辑功能；
3、熟悉利用数据选择器构成任意逻辑函数的方法；
4、了解数据选择器的扩展方法。
二、实验设备及其器件
1、SAC-DM32数字电路实验箱
1
个
2、74LS153
1
个
3、74LS32
1
个
4、74LS40
1
片
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三、实验原理
数据选择器，也称为多路选择器，其作用相当于多路开关，如图4-1所示。
（A1、A0）D0D1D2D3
图4-2双四选一数据选择器内部结构
1.双四选一数据选择器74LS153
所谓双4选1数据选择器就是在集成芯片上有两个4选1数据选择器。
双4
选1数据选择器内部结构如图4-2所示，引脚排列如图4-3，功能表如图4-1。
-20
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图4-374LS153引脚功能
1s'、2s'为两个独立的使能端；A1、A0为公用的地址输入端；1D0～1D3和2D0～
2D3分别为两个4选1数据选择器的数据使能端；Q1、Q2为两个输出端。
1）当使能端1
（2）=1时，多路开关被禁止，无输出，Q=0。
2）但使能端1
（2）=0时，多路开关正常工作，根据地址码A1、A0状态，
将相应的数据D0～D3送到输出端。
该电路的表达式为：
Y=（A1`A0`D0+A1`AOD1+A1A0`D2+A1A0D3）S`
表
4-1
输入
输出
S
A1
A0
D
Y
0
X
X
X
O
1
0
0
D0
D0
1
0
1
D1
D1
1
1
0
D3
D3
1
1
1
D4
D4
2、数据选择器的应用—实现逻辑函数
用数据选择器实现逻辑函数，方法与译码器相似，只是将出现的最小项对应
的数据端接入高电平，未出现的接低电平，将地址端作为自变量的输入端，则可
以实现。
四、实验内容
1.测试双四选一数据选择器的逻辑功能。
-21
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按图4-4在实验箱上接线，利用开关74LS153功能表逐项进行测试，观察
输出结果并记录于表4-2中。
实验仿真图如下：
表4-2
输入输出
-22
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S’
A1
A0
D
Y
1
X
X
X
0
0
0
0
D0
D0
0
0
1
D1
D1
0
1
0
D2
D2
0
1
1
D3
D3
2.用4选1数据选择器实现函数
F=A'BC+AB'C+ABC'+ABC
函数F有三个输入变量A,B,C,而数据选择器有两个地址端A1,A0少于函数
输入变量个数，在设计时可任选A接A1，B接A0，74LS153的表达式（或功能表）与函数F对照，得出：
D0=0,D1=D2=C,D3=1
接线图如图4-5所示，
-23
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实验仿真图如下：
测试并记录结果在表4-3.
表
4-3
输入
输出
A
B
C
F
0
0
0
0
0
0
1
0
0
1
0
0
0
1
1
1
1
0
0
0
1
0
1
1
1
1
0
1
1
1
1
1
五、实验总结
-24
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1.注意74LS153控制端的信号。
2.了解数据择器扩展时所用门电路的类型。
实验五触发器
一．实验目的：
1.掌握基本RS触发器、JK触发器、D触发器和T触发器的逻辑功能。
2.熟悉各触发器的逻辑功能及相互转换方法。
二．实验仪器
1、SAC-DM32数字电路实验箱
1个
2、74LS00（四2与非门）
1个
3、74LS112（双JK触发器）
1个
4、74LS74（双D触发器）
1个
-25
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三．实验原理
触发器是具有记忆功能的二进制信息存贮器件，是时序逻辑电路的基本单元之一。
触发器按功能分可分RS、JK、D、T触发器；按电路触发方式可分为电平触发和边沿触发器两大类。
图5-1所示电路由两个“与非”门交叉耦合而成的基本Rs触发器，它是无时钟控制低电平自家触发的触发器，有直接置位、复位的功能，是组成各种功能触发器的最基本单元。
基本RS触发器也可以用两个“或非”门组成，它是高电平直接触发的触发器。
图5-1RS触发器图5-2JK触发器
JK触发器是一种逻辑功能完善，通用性强的集成触发器。
在结构上可分为
主从型JK触发器和边沿型Jk触发器。
在产品中应用较多的是下降沿触发的边沿
型JK触发器。
JK触发器的逻辑符号如图5-2所示。
它有三种不同功能的输入端，第一种是直接置位、复位输入端，用R’和S’表示。
在S’=0，R’=1或R’=0，S’=1
时，触发器不受其它输入端状态影响，使触发器强迫置“1”（或置“0”），当不
强迫“1”（或置“0”）时，S’、R’都应置高电平。
第二种是时钟脉冲输入端，用
来控制触发器翻转（或称作状态更新），用CP表示（在国家标准符号中称作控
制输入端，用C表示），逻辑符号中CP端处若有小圆圈，则表示触发器在时钟
脉冲下降沿（或负边沿）发成翻转，如无小圆圈，这表示触发器在时钟脉冲上升
沿（或正边沿）发生翻转。
第三种是数据输入端，它是触发器状态更新的一句，
n+1n’n
用J、K表示。
JK触发器的状态方程为Q=JQ+K’Q
本实验采用74LS112型双JK触发器器，是下降边沿触发的边沿触发器，引
脚排列如图5-3所示。
表5-1为其功能表。
-26
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图5-374LS112引脚排列图
D触发器是另一种使用广泛的触发器，它的基本结构多为维阻型。
D触发器的逻辑符号如图5-4所示。
D触发器是在Cp脉冲上升沿触发翻转，触发器的状态取决于CP脉冲到来之前D端大的3状态，状态方程为
Qn+1=D
本实验采用74LS74型双D触发器，是上升边沿触发的边沿触发器，引脚排列如图5-5所示。
表5-2为其功能表。
图5-5
不同类型的触发器对时钟信号和数据信号的要求各不相同，一般说来，边沿触发器要求数据信号超前于触发器边沿一段时间出现（称之为建立时间），并且
要求在边沿到来后继续维持一段时间（称之为保持时间）。
对于触发边沿陡度也有一定要
求（通常要求<100ns）。
主从触发器对上述参数要求不高，但要求在CP=1期间，外加的数
据信号不容许发生变化，否则将导致触发器错误输出。
在集成触发器的产品中，虽然每一种触发器都有固定的逻辑功能，但可以利
用转换的方法得到其它功能的触发器。
如果把JK触发器的JK端连接在一起（称
-
升级会员 