CAN总线的波形图.docx
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CAN总线的波形图
总结一下:
can总线:
高电平暗示逻辑0,低电平暗示逻辑1.can总线的肇端场是一个bit的逻辑0(高电平),帧停滞由7个bit的逻辑1(低电平)构成.依据can总线的界说:
在产生的时刻,每持续五个bit的逻辑0,就会跟着填补一个bit的逻辑1;每持续五个bit的逻辑1,就会跟着填补一个bit的逻辑0.是以依据上面的波形解析数据的时刻,每消失000001这种数据串,那么1就是发送的时刻依据can协定填充进去的,所以解码的时刻1要去失落,即00000.再举个例子:
11111001暗示的数据应当是:
1111101.RS232:
(假定命据位8bit,停滞位1bit,无奇偶校验)-12v暗示逻辑1,+12v暗示逻辑0.依据波形解析的时刻,高电平暗示逻辑0,低电平暗示逻辑1.RS232发送数据是以ascii码的情势发送出去的.例如发送字符‘s’,现实上发送的就是0x73.每发送一个字符:
起首是一个bit的肇端位(逻辑0),然后将ascii值的最低位发送出去,接着是次高位....总之是低位在前,高位在后.例如0x73,发送的时刻就是:
0b11001110.接着就是1个bit的停滞位(逻辑1).1个bit的逻辑的时光宽度就是:
1/波特率(单位是秒).