译码器PPT课件下载推荐.ppt

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将输入的每个代码分别译成高电平（或低电平）。

3,完全译码器n个输入端具有2n个不同组合状态，输出端m=2n。

不完全译码器n个输入端具有2n个不同组合状态，输出端m2n。

对于输入的某一组代码，若只有相应的一条输出线为高电平，其余的输出线皆为低电平，称为输出“1”电平有效，或称译中输出为“1”。

也有的译码器设计成只有相应的一条输出线为低电平，其余的输出线为高电平，称译中输出为“0”。

4,1二进制译码器,1）真值表,3）逻辑图,1、2位二进制译码器,2）输出表达式,输入,输出,A1A0,Y3Y2Y1Y0,10,00,11,01,0001,0100,0010,1000,4）逻辑符号（2线4线译码器）,输出0有效的2线4线译码器可用与非门构成，,输出1有效,5）常用集成2线4线译码器,74LS139：

双2线4线译码器,输出0有效,74LS139,6,中规模集成74LS139译码器,在一个封装内包含两个独立的2线4线译码器。

7,74LS139的功能表（真值表）：

因与非门输出为“0”电平时，功耗较大。

而采用译中输出为“0”电平时，其余三个门的输出端就为“1”电平，可以降低整个电路的功耗，所以译码器的输出常采用反码输出。

即译中输出为“0”。

8,

（2）3线8线译码器74LS138（完全译码器）,9,在计算机系统中常用作存储器或I/O接口芯片的地址译码器。

而输入A0、A1、A2则为地址码。

10,74LS138的真值表,A0、A1、A2为输入端；

11,1,0,12,例3-5用二片3线8线译码器构成4线16线译码器。

图中D为最高位，A为最低位。

当D=0时，选中第片74LS138。

当D=1时，选中第片74LS138。

扩展方法:

利用使能端，作为第四个（最高位）地址输入端。

13,得到4线16线译码器,由表可见，高8位与低8位主要是第四位（最高位D）不同，即两片的后三位地址端是一样的。

0,1,14,0,1,0,0,15,可见,如果把输入信号当成逻辑变量,输出信号当成逻辑函数,则输出信号Y0Y7就是A2、A1、A0三个输入变量的全部最小项的译码输出,故又称为最小项译码器。

16,例如一个3线8线译码器，能产生3变量函数的全部最小项，利用这一特点能够方便地构成3变量的组合逻辑函数，从而实现组合逻辑电路的设计，并且不需要经过化简过程。

译码器的用途很广，由于二进制译码器的输出端能提供输入变量的全部最小项（每一个输出端对应一项最小项），而任何组合逻辑函数都可以变换为最小项之和的标准式，因此利用二进制译码器和一些附加的门电路将这些最小项恰当的组合起来，就可实现任何组合逻辑函数。

二进制译码器（最小项译码器）输出信号与输入变量最小项关系的一般形式为,17,解：

（2）根据逻辑函数选择译码器,例3-试用译码器和门电路实现逻辑函数。

（1）将函数式变换为最小项（标准与或）表达式,由于有A、B、C三个变量，故选用3线-8线译码器。

选用CT74LS138。

F（A、B、C）=m（1,3,5,6,7）,选择译码器的原则：

逻辑函数变量数应与译码器输入二进制代码位数相等。

18,F（A、B、C）=m（1，3，5，6，7）=m1+m3+m5+m6+m7,因为此处的最小项是关于A、B、C的最小项，所以应将输入变量A、B、C分别加到译码器的地址输入端A2、A1、A0。

即令A2=A，A1=B，A0=C。

19,当译码器输出为低电平有效时，多选用与非门与之配合；

当译码器输出为高电平有效时，多选用或门与之配合。

（3）根据译码器的输出有效电平确定需用的门电路,20,循环码又称为反射码、格雷码（GrayCode）。

右表为四位循环码的编码表。

由表可见，任意两个相邻代码只有一位数字不同，而且首尾（0和15）两个代码也仅有一个数字不同。

如果将表中的0、1数字按竖直方向读数，则数码的读数是循环重复的。

如最低位按“0110”循环重复，次低位按“00111100”循环重复，以此类推。

循环码是一种变（无）权码，即编码中每一位的1并不代表固定的数值。

循环码,余3循环码,余3循环码比一般循环码从0000开始计数的状态多3。

如余3循环码的0正好是一般循环码的3，是按循环码首尾各去掉3种状态而得，它也是一种变权码。

21,例3-6设计一个余3循环码到8421BCD码的代码转换电路（要求用译码器实现）。

解：

（1）列出输出函数的最小项（标准与或）表达式,2代码转换电路,22,选用CT74LS154，并令74LS154的地址输入端A3=D，A2=C，A1=B，A0=A，则它的各输出端对应各输入变量最小项的反函数形式。

即Y0Y15分别对应m0m15。

（2）根据逻辑函数选择译码器,由于有D、C、B、A四个变量，故选用4线16线译码器。

在74LS154之后再加四个与非门就可以实现这些函数，完成余3循环码到8421BCD码的代码转换。

23,综上所述可知，从原理上讲，利用二进制译码器和适当的门电路，可以实现任何组合逻辑函数，尤其适合用来构成有多个输出的组合逻辑电路。

24,这种译码器是4线-10线译码器,它的功能是将8421BCD码译成10个有效电平（高电平或低电平）的输出信号,所以称其为二十进制译码器，属于代码变换译码器。

常用的有5474LS42、5474HC42等。

二十进制译码器（不完全译码）,当伪码输入时,十个输出端均为非有效电平。

如输出低电平有效,当伪码输入时,输出均为高电平,处于无效状态。

4位地址输入端,输入代码“0-9”时有对应的输出,输入代码“10-15”为伪码,没有与之对应的输出,10个译码输出端,作业：

3-6、3-7、3-8,25,3七段显示译码器,在数字系统中常要将测量或处理的结果直接显示成十进制数字。

因此，首先将以二进制码表示的结果送译码器译码，用它的输出去驱动显示器件，所以它主要由译码器和驱动器两部分组成，通常这两者都集成在一块芯片中。

由于显示器件的工作方式不同，对译码器的要求就不同，译码器的电路也不同。

常用的显示器件有多种。

目前常用的七段显示器件有半导体显示器（发光二极管LED）和液晶显示器件（LCD）。

另外有荧光显示器。

（1）七段显示器,26,半导体显示器是由7个发光二极管（若加小数点则为8个）组成。

七段LED数码管有共阴极和共阳极两种。

共阴极LED数码管的七个发光二极管的阴极连接在一起接地，另外七个阳极分别经由七个管脚引出。

27,如LED显示器为共阳极的，则要求译码器输出低电平，各显示段才发光。

如LED显示器为共阴极的,当相应的阳极段为高电平时，则该段发光。

显然这时要求译码器输出为高电平。

（2）七段显示译码器,七段显示译码器的功能是将“8421”二十进制代码译成对应于数码管的七个字段信号，以驱动数码管，显示出相应的十进制数码。

28,七段显示译码器的结构和功能示意,29,在图中：

DCBA是8421BCD码的输入信号，高电平输入有效。

ag是译码器的七个输出，低电平输出有效，因此适合于共阳极LED七段数码管使用。

除了输入、输出端外,74LS47还有一些辅助控制端。

适用于七段字形的共阴极显示管的译码器集成电路有74LS48、74LS49，适用于共阳极显示管的译码器有SN7447、74LS47等型号。

30,灯测试输入。

低电平有效。

灭零输入，用来熄灭不需要显示的0。

灭灯输入/灭零输出（双重功能）。

均为低电平有效。

31,1）D、C、B、A为译码器的输入端，a、b、c、d、e、f、g为译码器的七段输出端，低电平有效。

D、C、B、A的编码决定显示结果。

0110显示6。

2）灯测试输入。

低电平有效，用来测试数码管的好坏。

当，同时时，无论AD状态如何，ag全为低电平，数码管七段全被点亮。

3）灭零输入,用来熄灭不需要显示的0，低电平有效。

=0时，=1,当DCBA=0000时,使ag均为1,显示器不显示0；

而当DA输入其它数值时,显示器均能正常显示,即只熄灭数码0,不熄灭其它数码。

32,设置这个状态的目的是为了能把不希望显示的零熄灭掉。

例如：

电子钟,整数部分高位接“0”,低位“1”。

小数部分高位接“1”，低位“0”。

33,7447的最大输出电流达24mA，在实际使用中，需采用合适的限流电阻与共阳数码管相连。

译码器与数码管的连接如图3-14所示。

7448输出高电平有效，适用于共阴数码管，其它功能引脚与7447完全一样。

7448内部接有限流电阻，可直接驱动共阴数码管的显示。

34,例3-用3线-8线译码器74LS138实现下列多输出组合逻辑函数。

输出的逻辑函数式为,解：

（1）将给定函数变换为最小项之和的形式,35,运用还原律和摩根定理将函数变换为,在74LS138之后再加四个与非门就可以实现这些函数。

36,在用高电平输出有效的译码器实现组合函数时，译码器输出为各地址输入变量最小项的原函数。

只要将电路中的与非门换成或门就可以了。