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最新数字电子练习题

第一部分门电路

一、填空题

1.数字集成电路按开关元件不同，可分为

2.数字电路中的三种基本逻辑门电路是

_TTL集成电路_和_CMO集成电路_两大类。

与门、或门、非门。

3.三态门是在普通门的基础上增加

控制电路构成的，它的三种输出状态是高电平、

B—

▽

EN―c

丁■Y

图1填空题5用图

低电平和_高阻态。

4.与门、与非门的闲置输入端应接高_电平；或门、或非门的闲置输

入端应接_低_电平。

5.图1所示三态门在EN=1时，Y的输出状态是_高阻态_。

6.利用TTL与非门实现输出线与应采用_0°门，实现总线传输应采用

7.图2为几种常见逻辑门电路的逻辑符号，试分别写出其名称和逻辑表达式。

A——

B——

.—YA—

B—

A—

>—Y

B—

>—Y

（a）

（b）

（c）

（d）

图2填空题7用图

名称

逻辑表达式

名称

逻辑表达式

（a）

与门

Y=AB

;（b）非门

S5S：

；

（c）

与非门

S5S=；

（d）或非门

。

8.当决定某一件事情的多个条件中有一个或一个以上具备时，该件事情就会发生，这种关

系称为_或_逻辑关系。

选择题

1.下列几种逻辑门中，

能用作反相器的是

。

A.与门

B.或门

与非门

2.下列几种逻辑门中，

不能将输出端直接并联的是

A.三态门

B.与非门

C.OC

门

3.TTL与非门的输入端在以下四种接法中，在逻辑上属于输入高电平的是_J。

A.输入端接地B.输入端接同类与非门的输出电压0.3V

C.输入端经10kQ电阻接地D.输入端经51Q电阻接地

4.TTL与非门的输入端在以下4种接法中，在逻辑上属于输入低电平的是_D_。

A.输入端经10kQ电阻接地B.输入端接同类与非门的输出电压3.6V

C.输入端悬空D.输入端经51Q电阻接地

5.逻辑电路如图3所示，该电路实现的逻辑关系为

C。

A.Y=AB

丫=ABC.

Y=ABD.丫=AB

6.图4为TTL逻辑门，

其输出

Y为D。

A.ABC

ABCC.

ABCD.AB

A一

_YA_

o—Y

YA—

_——

B—

（C）

（A）

（D）

11用图

（B）

图7选择题

六、画图题

先写出图12所示各门电路的逻辑表达式，再根据输入信号A、B的波形，对应画出各个

10.

11.

图3选择题5用图

图5电路实现的逻辑功能是

A.Y=ABB.

门电路使用时需要外接负载电阻和电源的是

A.与门B.与非门

Y=ABC.

5选择题7用图

图

Y=A二B

D。

Y=AOB

异或门

D.OC

以下各种接法不正确的是

A.与非门闲置输入端接1

C.TTL与非门闲置输入端悬空

图6中能实现Y=AB功能的

TTL

（A）

或非门闲置输入端接地

D.CMOS

门是B。

+5V

（B）

图6选择题10用图

图7中，能实现丫二AbAB的逻辑门是_c_。

门闲置输入端悬空

（C）

12.

图8中电路连接和给定逻辑功能都正确的是

Vcc

—

L-

—

y_■

Vcc

Y=ABCD

（A）

（B）

图8选择题

（C）

12用图

A—B—

（D）

门的输出波形。

A——

1—

A—

B——

解:

Yi=A

Y2=1

Y3=A+B

Y4=AB+AB

波形如图12

第二部分组合逻辑电路

一、填空题

1.逻辑代数的三种基本逻辑运算是_与_、或_和非_，在电路上，分别用_与_门、

_或_门和_非_门来实现。

2.逻辑变量和逻辑函数的取值只有_0_和1_两种可能。

3.逻辑函数的表示方法有_真值表、逻辑表达式、逻辑图、波形图、卡诺图五种。

4•“全1出0，有0出1”描述的逻辑关系是_与非逻辑_。

5.110，1100_1。

6.AB，AB二，AAb二_A+B，ABAB=_A_o

7.ABC-101时，函数Y=ABBC之值为丫二_1_o

8.二进制的基数是_2，其第i位的权值是21-1o

9.在二-十进制码中，1位十进制数用_4—位二进制码表示，8421BCD码从高位到低位的权

值依次为_8、4、2、1

10.（93）10=（1011101_）2,（93）10=G10010011_）8421BCD

11.最简与或式的标准有两个，即与项数最少_、—每个与项中变量数最少o

12.常用的集成组合逻辑电路有—编码器、译码器、数据选择器_等。

13.编码器的功能是将输入信号转化为_二进制代码输出_。

14.编码器可分为_二进制编码器_和_二-十进制编码器_，又可分为_普通编码器—

和_优先编码器。

15.常用的译码器电路有_二进制译码器_、_二-十进制译码器_和_显示译码器—等。

16.七段显示译码器74LS48输出高电平有效，用以驱动共阴极LED显示器。

当输入

A3A2A1A0=0101时，输出abcdefg=_1011011，显示字形_5_。

17.数据选择器的逻辑功能是_从2n个输入信号中选择一个送到唯一输出端数据分配器

的逻辑功能是—根据地址信号的要求将公共总线上的一路输入数据分配到指定输出通道上

去。

选择题

“入1出0，入0出1”的逻辑运算关系属于_C_。

A.与运算B.或运算C.非运算D.与非运算

使函数Y=ABAB的值为0的变量取值组合为

AB二C。

A.00、11B.00、10C.01

使函数Y=ABCD之值为1的变量取值组合是

A.AB=00，CD至少有一个0

、10

D.01

、11

C.AB=10，CD=11

Y=ABCACBC,当A=C=1时，_Y=BC.

A.Y二BB.

5.3个逻辑变量的取值组合共有

A.3

B.6

AB=01

CD至少有一个1

C种。

C.8

AB=11

CD任意组合

D.16

Y=1

A.丫二ABB.丫二AB

丫二丽C

丫二ABC

与ABACBC相等的式子是A

。

A.ABCB.ABAC

ABBC

ABAB

图1所示波形关系的逻辑函数表达式为

C。

A.Y=ABB.Y=AB

Y=A二B

Y=AOB

F列逻辑函数属于与非式的是

B。

图1选择题8用图

表1所示的真值表，其函数式为C。

10.

A.丫=AA二BB.丫=AA二B

余3码的0011对应的十进制数是C。

C.Y=AA二BD.Y=AA二B

11.

A.3

B.6

C.0

D.9

二进制数10010110转换为十进制，应得

A.150

B.151C.96

D.98

丫

表1选择题9真值表

12.

13.

属于无权码的是B。

十进制数35转换为二进制数得_A_，转换为8421BCD码得—C_。

A.100011B.100001C.00110101D.01010011

14.

15.

A.8421码B.

组合逻辑电路通常由

A.门电路B.

8线-3线优先编码器

A.000

B.101

余3码C.2421码

A组成。

编码器C.译码器

74LS148,低电平输入有效，反码输出。

C.010

D.100

16.优先编码器同时有两个或两个以上信号输入时，是按

A.高电平B.低电平C.高频率

17.8421BCD译码器74LS42输出低电平有效，当输入

A.0000000010B.1011111111

C.0100000000D.1111111101

18.4选1数据选择器构成逻辑函数产生器的电路连接如图示，该电路实现的逻辑函数是

A.Y=AB

丫二Abab

自然二进制码

数据选择器

当对I5编码时，输出丫2丫1丫0

给输入信号编码。

D.高优先级

AAAA=1000时，其输出Y0zY9等

——4选1

ENMUX

C.Y=ABAB

图2选择题18用图

四、计算题

将下列十进制数转换为二进制数。

（1）（25）10=（11001）2将下列二进制数转换为十进制数。

（1）（1001）2=（9）10将下列各数转换为8421BCD码。

（1）（100011）2=（00110101）将下列数码分别看作自然二进制数和

（1）10010111

（10010111）2=（151）10

（10010111）8421BC=（97）10

（53.25）

10=（110101.01）2

（2）（1001011）=

（75）10

8421BCD

（2）（231）10=（001000110001）

8421BCD码，求出相应的十进制数。

（2）010101100011

（010101100011）2=（1379）10

（010101100011）8421BC=（563）

8421BCD

五、组合逻辑电路设计题

1.某产品有AB、CD四项指标。

其中规定主要指标A、B必须满足要求，其余指标C、D只要有一个达标即可判定产品Y为合格。

试设计一个逻辑电路实现此产品合格判定功能，要

求：

（1）列出真值表，

（2）写出输出函数的最简与或式，（3）画出用与非门实现该电路

的逻辑图。

解：

（1）

输入

输出

ABCD

1101

1110

1111

（2）

（3）

一台功率为

个逻辑

现有三个车间，每个车间各需10kW电力，这三个车间由两台发电机组供电,10kW另一台功率为20kW三个车间经常不同时工作。

试用与非门和异或门设计电路，能够根据各车间的工作情况，以最节约电能的方式自动完成配电任务。

解：

（1）

输入

输出

丫1

丫2

（3）

SiS2

YoYl丫2丫3丫4丫5丫6丫7

3.用集成译码器74LS138和4输入与非门实现表2所示真值表的逻辑功能。

先写出逻辑表达式，再画出逻辑电路图。

输人

输出

表2组合逻辑电路设计题3真值表

解:

（1）

（2）

74LS138

A2AlAoS2AS2BSi

IIII

ABC+5V

4.分别用8选1数据选择器和4选1数据选择器实现逻辑函数Y=ACBC,画出逻辑图。

解:

（1）

—

A174LS151

DoD1D2D3D4D5D6D7

111

丁

（2）

B1UU

I・4oo123EAADDDD

5.设计一个电路实现图3所示的逻辑功能。

要求：

（1）列出真值表，（式，（3）用4选1数据选择器实现电路。

2）写出函数表达

解：

（1）

图3组合逻辑电路设计题5用图

输入

输出

丫

（2）

丫二ABAB

（3）

4选1

：

MUX

B—

Aoy

0一

1—

1一

0—

六、组合逻辑电路分析题

1.试分析图4所示电路的逻辑功能。

解：

（1）

丫二ABACBC二ABACBC

（2）

输入

输出

（3）三人表决器电路

2.试分析图5所示电路的逻辑功能。

图5电路分析题2用图

解:

Y=ABAB=（AB）（AB）=ABAB

输入

输出

二变量同或电路

3•图6是BCD-七段显示译码/驱动器74LS48驱动一位数码管的连接方法。

请问，当输入8421BCD码为AAAAg=0011时，图中发光二极管LED^LEDg的亮灭情况如何？

数码管显示的字形是什么？

1kQX7

七段数码管BS201

LEDa、LEDg

BCD码斗

输入

74LS4d

BI/RBO

RBrGNDg

电路分析题3用图

解:

a、b、c、d、g亮，e、f灭。

显示“3”

4.二-十进制译码器74LS42按图7连接。

请列出电路的真值表，说明电路的逻辑功能。

74LS42

使能输入A

地址码输入

代A代

置

45;闲YYYYL二二二

图7电路分析题4用图

解:

使能端

输入

输出

译

码

0）

全

部为

为

由真值表可知，电路实现3线-8线译码器的逻辑功能。

C为输入变量。

试写出输出函

3线-8线译码器74LS138构成的电路如图8所示，AB、数Y的最简与-或表达式，列出真值表，描述此电路的逻辑功能。

解：

（1）

（3）

判奇电路

（2）

占

[

.111

丫1

丫2

Y3丫4丫5丫6丫7

74LS138

S2AS2BS1

+5V

ABC

图8电路分析题5用图

第3章集成触发器

一、填空题：

1•触发器有_两_个稳定状态，当Q=0,Q=1时，称为_o_态；当Q=1,Q=0时，称为」—态。

2.基本RS触发器有保持—、置0、置1_功能；D触发器有_置0_和_置1功能。

3.JK触发器具有—保持、—置0、置1_和—翻转—的功能。

4•欲使JK触发器实现Qn"=Qn的功能，则输入端J应接—高电平，K应接高电平。

5.触发器的逻辑功能通常可用真值表、特性方程、状态转换图和工作波形图四种方

法描述。

6.由两个与非门组成的同步RS触发器，在正常工作时不允许输入S=R=1,即约束条件为SR=

0_。

7.触发器按逻辑功能分为_RS_、比、_D—、、T'五种类型。

8.欲将JK触发器转换为T触发器，只需令J=_K_=_T_，去掉JK触发器的_

置0和置1_两种功能即可。

二、选择题:

由与非门组成的基本RS触发器，不允许输入

RD和SD的变量取值组合为

A.00B.01

C.10D.11

存在空翻问题的触发器是

A.边沿D触发器

同步RS触发器

主从JK触发器

仅具有“置0”“置1”

功能的触发器叫_C

A.JK触发器

B.RS

触发器

C.D

触发器

仅具有“保持”“翻转”

功能的触发器叫

A.JK触发器

B.T

触发器

C.D

触发器

具有“置0”“置1“保持”和“计数翻转”功能的触发器叫

A.JK触发器

B.D

触发器

C.T

触发器

6.仅具有“翻转”功能的触发器叫

B。

A.JK触发器

B.T

'触发器

C.D

触发器

7.JK触发器用做T

触发器时，

控制端J、K正确接法是B

。

A.J=QnK=QnB.J=K=1C.J=QnK=Qn

&D触发器用做T'触发器时，输入控制端D的正确接法是_B_。

A.D=QnB.D=QnC.D=1

9•触发器由门电路构成，但它不同于门电路的功能，主要特点是_B_。

A.和门电路功能一样B.有记忆功能C.没有记忆功能

10.TTL型触发器的直接置0端Rd、置1端Sd正确用法是C。

A.都接高电平“1”B.都接低电平“0”C.逻辑符号有小圆圈时，不用时接高电平“1”，没有小圆圈时，不用时接低电平

“0”

11.当T触发器的T=1时，触发器具有_C_功能。

A.保持B.禁止C.计数D.置位

12.为防止空翻，应采用C结构的触发器。

A.CMOSB.TTLC.

13.存在一次翻转现象的触发器是_C_

A.边沿JK或边沿D触发器B.

14.以下触发器受输入信号直接触发的是

A.基本RS触发器B.

15.不能用作计数器的触发器是_A_。

A.同步RS触发器B.

同步RS触发器

主从JK触发器

A。

同步RS触发器

C.JK

触发器

边沿D触发器

边沿JK触发器

主从或维持阻塞

16.在CP有效时，若JK触发器的J、K端同时输入高电平，则其次态将会_D

A.保持B.置0C.置1D.翻转

17.存在不定状态的触发器是_A。

A.RS触发器B.D触发器C.JK触发器D.T触发器

四、画图题

1.在基本RS触发器中,

已知RD、SD的波形如图

1所示,

试画Q,

Q的波形。

（初态Q=0）

需I

图1画图题1用图

（初态Q=0）

2.在同步RS触发器中，已知R、S的波形如图2所示，试画Q，Q的波形。

解：

画图题2用图

3.已知D锁存器有输入波形如图3所示,

试画出其Q端的波形（设触发器初态为Q=0。

解:

*;—

11i"

・11

14*1

图3画图题3用图

4•画出两种JK触发器的逻辑符号：

（略）

（1）CP脉冲上升沿触发有效；

（2）CP脉冲下降沿触发有效。

5.若JK触发器初态为0,试根据图4中CPJ、K端波形画出Q,Q的波形。

上升沿触发下降沿触发

cp」""LT'Lr~U_LJ_Lcp—~Ll_C」~LTL

IIaAIillib

II>・•|i4V|id

|VVI|i—IH||i

kItKl>t4HII

qi_n_juq

图4画图题5用图

6.已知CP,D和T的输入波形如图5,试画出其相应的输出波形。

设初态Q=0。

cP_n_run_njT

IIiI■

图5画图题6用图

7.在图6（a）所示电路中，加入图6（b）所示的输入波形，试画出其Q端波形，设触发器

初态为Q=a

（a）

IDQ

>CI

0—

D=XQ

-n

图6画图题7用图

（b）

8.如图7各触发器，可设

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