电磁兼容与信号完整性设计规范Word格式文档下载.docx
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（待补充）
4.5互连电缆设计技术
互连电缆的接地
屏蔽电缆一般分为低频电缆和高频电缆
Ø
对低频信号电缆屏蔽层应单点接地
对屏蔽的电力电缆和高频电缆的屏蔽层至少应在电缆两端接地。
当电缆长度L<
0.15λ时，要求单点接地，一般均在输出端接地，不存在接地环路，磁屏蔽效果好，也可在输入端接地；
当电缆长度L>
0.15λ时，采用多点接地，一般屏蔽层按0.05λ或0.1λ的间隔接地，以降低地线阻抗，减少地电位引起的干扰；
对于输入信号电缆的屏蔽层，不能在机壳内接地，只能在机壳的入口处接地，此时的屏蔽层上的外加干扰信号直接在机壳入口处入地，避免屏蔽层上的外加干扰信号带入设备内的信号电路上；
对于高输入或高输出阻抗电路，尤其是在高静电环境下，可能需要双层屏蔽的电缆，此时内屏蔽层可以在信号源端接地，外屏蔽层则在负载端接地。
4.6印制板设计技术
4.6.1印制板设计的基本原则
减少设计带宽
通常办法
⏹电源输入端滤波
⏹
⏹IC芯片滤波
⏹存储型器件接去耦电容
基尔霍夫定律
差模/共模电流的耦合控制
印制线间距的准则（3-W原则）
⏹存在于PCB走线之间的串扰不仅与时钟或周期信号有关，而且与系统中的其他重要走线有关。
数据线、地址线、控制线和I/O都会受到串扰和耦合的影响。
⏹3-W原则：
走线间的距离间隔（走线中心间的距离）必须是单一走线宽度的3倍。
5/5原则
⏹时钟频率超过5MHz或上升时间小于5ns时，需要使用多层板。
4.6.2信号完整性设计
信号完整性（SI）是指在信号线上的信号质量好坏；
在要求的时间内，信号能以要求的时序、持续时间和电压幅度作出响应，不失真的从源端传递到接收端。
高速信号的电磁干扰以及传输线效应将导致信号完整性降低，出现串扰、数据丢失、判断出错等问题。
影响信号完整性的主要因素有：
电路与网络的阻抗不匹配所引起的反射。
（线宽变化、信号层间转移、接插件与分支线、源端负载不匹配等）
电路与网络间的分布参数所引起的信号串扰。
（分布电容、分布电感）
有源及功率器件开关所引起的电源及地的电位波动。
控制方法
反射的抑制
串扰的抑制
减小两根或多根信号线的平行长度；
尽可能加大两平行线的间距；
3-W原则代表的是逻辑电流中近70%的通量边界
⏹10-W原则代表的是逻辑电流中近98%的通量边界
距接地面的距离减小可以使串扰耦合迅速减小
⏹在PCB（尤其是高频电路PCB）的设计中，可以在装元件的一面用铜箔作为地平面，使其串扰显著减小；
⏹对于微带传输线和带状传输线，将走线高度限制在高于地线平面10mil以内，可以显著减小串扰。
⏹在串扰较严重的两条线之间插入一条地线，可以起到隔离的作用，从而减少串扰。
4.6.3电源完整性设计
电路设计的结果是从信号完整性上表现出来的，但不能忽略电源完整性设计。
因为电源完整性直接影响到PCB板的信号完整性。
电源完整性和与信号完整性二者是密切相关的，而且很多情况下，影响信号畸变的主要原因是电源系统。
例如，地反弹噪声太大、去耦电容的设计不合适、回路影响很严重、多电源/地平面的分割不好、地层设计不合理、电流不均匀等等。
4.6.4单层印制板设计技术
参照PCB设计规范
4.6.5多层印制板设计技术
4.7EMI滤波设计技术
EMI滤波包括EMI电源滤波与EMI信号线滤波。
其中
4．7．1电源滤波的工程应用必须考虑以下特性
●器件温度特性
●
●耐压及漏电流限制
●磁性材料的磁饱和问题
●安装及使用要求
●阻抗失配端接原则
按照阻抗失配端接原则采用的滤波电路结构如下图
EMI电源滤波器的安装应该注意
减小接地阻抗，滤波器应安装在导电金属表面或通过编织接地带与接地点就近相连，避免细长接地导线造成较大的接地阻抗。
滤波器应尽量安装在设备的入口/出口处。
●为避免输入/输出互相耦合，应尽量做到输入/输出隔离，至少严格禁止滤波器输入/输出线的相互交叉、路径平行等。
若由于位置及空间的限制，无法满足上述要求的，则滤波器的输入/输出线必须采用屏蔽线或高频吸收线。
4．7．2EMI信号滤波器
4.8接地与搭接技术
（参照烽火通信《接地设计规范》）
4.9瞬态干扰及抑制技术
a）
b）
c）
d）
4）
5）
A）
B）
C）
D）
E）
F）
G）
H）
I）
J）
i）
ii）
iii）
a）
10.相关文件
11.
5.1参考标准
EN55022ElectromagneticEmissionsTestProcedure
EN61000-3-2PowerHarmonicsTestProcedure
EN61000-3-3FlickerTestProcedure
EN61000-4-2ESDTestProcedure
EN61000-4-3RadiatedRFImmunityTestProcedure
EN61000-4-4ElectricalFastTransientTestProcedure
EN61000-4-5LightningSurgeTestProcedure
EN61000-4-6ConductedRFImmunityTestProcedure
EN61000-4-11PowerInterrupts,Variations,andDisturbancesTestProcedure
5.2参考企业规范
5.3参考文章
12.附件
13.
6.1电磁兼容国际标准化组织介绍
标准化组织关系图
不同标准化组织的标准编号规则
电磁兼容标准体系结构
6.2设计案例
下图给出一个机盘布线示意图，其中对电磁辐射和抗扰有严格要求的区域都以符号标注出来。
现实中，图中标注的布线区域可能并不同时存在，但是它们代表了系统（设备）现场运行将面对着的电磁辐射、电磁抗扰以及ESD防护等问题。
对部分布线区域的元件放置与布线设计给出了详细说明。
标注1
建议在靠近前面板预留一隔离区域，用以设计ESD环，I/O电缆滤波与解耦敷铜。
其他走线与敷铜都不允许穿越此保留区域。
设计目的–减少PCB边缘与前面板的辐射或耦合、建立I/O滤波的参考面与ESD放电区。
标注2
在所有布线层中，在与前面板相邻的屏蔽地和ESD环的区域周围，建立最小0.7mm宽的间距区。
间隔区应沿着双点划线保持连续。
设计目的–减少耦合到顶部与底部的PCB边缘效应，建立单盘功能区的边界。
标注3
ESD操作环的设计
设计目的–保证在制作和安装过程中的单盘操作ESD要求
标注4
双点划线区域内为功能电路与敷铜区域
设计目的–PCB功能区域，用于放置元件、走线与敷铜。
标注5
48V电源转换的隔离区域设计。
设计目的–耦合到功能区域的电源模块的开关dI/dt噪声最小化，耦合到48VI/O连接件的单盘时钟最小化。
标注6
SFPandXFP光收发模块的布线设计
设计目的–参照多源协议厂家提供的SFP和XFP模块的推荐布线设计。
标注7
机壳地与屏蔽地的连接，用以PCB板与铜质线缆接口的共模滤波和ESD泄放。
设计目的–地的连接
标注8
10/100Base-T接口元件的走线
设计目的–满足以太网接口的辐射与抗扰要求。
标注9
RS-232串行接口元件的走线
设计目的–满足串行通讯口的辐射与抗扰要求。
6．2．1DC-DC电源供电的布线设计
1.在双点划线的区域内建议不要敷铜；
2.信号线与监控信号线在未光学隔离的条件下，建议不要穿越双点划线区域；
3．在滤波元件（线圈）放置的区域（参见短划线之间的区域）,建议在任何布线层都不要敷铜；
4．采用光耦隔离穿越双点划线的电源监控信号线；
目前很多设计中，在滤波元件下方采用敷铜以抑制开关电源电路与通过DC-DC电源内寄生元件耦合进来的系统时钟谐波所产生RF噪声。
但是在滤波元件下方的任意布线层敷铜，都肯定会在滤波器的输入输出端之间引起高频短路，这将限制滤波器的滤波效果。
图中包含了2个差模电感、3个差模电容与1个共模电感，在图中短划线之间的区域不要敷铜。
电源滤波器的最佳位置就是与电源模块的输入端直接相邻，但这需要2个滤波器（例如，每一个滤波器对应一路电源输入）。
滤波器靠近电源输入端，可以限制滤波器与输入端之间的铜箔走线长度，以免电磁辐射耦合到滤波器中。
有效的电源滤波通常采用Faraday屏蔽罩进行屏蔽，以防止电磁辐射耦合到滤波元件中。
6．2．2SFPandXFPMSA光收发模块的布线设计
SFP与XFP屏蔽网笼的结构参数可以参见厂家提供的数据。
下图中只是给出的多源协议要求的的布线设计说明。
1.阅读SFP和XFP的多源协议文档，了解光收发模块的布线设计要求；
2.网纹标注区域是网笼在顶层的安装区域。
顶层的机壳地敷铜在任何时候都不能舍弃。
与顶层相邻的内层不能作为信号布线层；
3.多源协议要求网笼安装的网纹标志区域不允许放置元件或走线，网笼底部的任意层内最好都不要走线或敷铜。
因为
从内部敷铜面容性耦合到顶层的高频RF，将会引入共模电流到前面板上。
如果网笼底部的区域确实需要用来布线，那么需要从PCB另一侧的底层开始布线
；
4.在网笼区域下方不要走时钟或高速信号线；
5.如果Tx或Rx差分线从内层进行走线，那么过孔引起的反射会劣化回损指标，从而危及到信号完整性；
6.内层来的过孔不允许放置在网笼安装的网纹区域。
6．2．310/100/1000Base-T以太网接口的布线设计
图给出10/100Base-T与外部线缆接口的布线设计要求。
1.与外部线缆相关的所有端接元件都必须与RJ-45连接器直接相邻。
2.变压器中心抽头线缆侧的端接电容与外部线缆端接元件的绝缘性能，要能满足
1500Vrms1分钟；
3.所有与线缆和变压器中心抽头线缆侧直接连接的端接元件，都必须以机壳地为终结参考。
不要将外部线缆端接的元件放置在数字布线区域，或是将这些元件终结到数字布线区；
4.以太网收发芯片侧变压器的元件或走线都不允许放置在为以太网线缆输入的保留区域内。
5.理想的元件放置如上图所示，除了时钟线最好是放置在PCB板的另一侧以保证与以太网收发芯片时钟输入管脚的最短连接。
6.TX和RX差分线的走线不能与时钟和高速数字线相邻。
7.在RJ-45接口附近区域不允许放置时钟源，走时钟线或高速数字信号线。
8.
除了屏蔽地，在以太网阻抗平衡变压器和变压器与
RJ-45连接器之间的区域的正下方的任意层内都不允许有走线或敷铜面。
记录
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